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加器快梁政邵志标沈绪榜摘要：为适应嵌入式低功耗微处理器的应用，提出了可同时实现浮点乘除法和平方根计算宏模块的同步串行实现方式．乘法计算采用算法迭代，除法与平方根计算的实现采用基算法，在迭代中共用商位查询表，可同步实现部分冗余结果向非冗余二进制的转换．为加快迭代的速度，摒弃了进位传递加法器，而采用进位存储加法器来实现迭代中的加法运算．宏模块设计控制逻辑简单，资源面积占用少，迭代时间短，经可编程逻辑器件验证，速度可提高倍以上．在此基础上，提出了对除法和平方根计算异步自定时实现方式的改进方案，该实现方式不仅易于版图布线，而且大大降低了瞬态功耗．作者单位：西安微电子技术研究所西安交通大学电子与信息工程学院西安微电子技术研究所：超大规模集成电路计算机算术除法平方根基金：航天科技集团研究基金资助项目．分类号：.正文快照：在现代微处理器系统中，浮点算术运算的速度和精度随着半导体工艺水平的进步有了很大的提高，但直接并行实。